Archivio Istituzionale della RicercaStatic linked faults are considered an interesting class of memory faults. Their capability of influencing the behavior of other faults causes the hiding of the fault effect and makes test algorithm design and validation a very complex task. This paper presents a memory fault simulator architecture targeting the full set of linked faults.
Memory Fault Simulator for Static-Linked Faults / Benso, Alfredo; Bosio, Alberto; DI CARLO, Stefano; DI NATALE, Giorgio; Prinetto, Paolo Ernesto. - STAMPA. - (2006), pp. 31-36. (Intervento presentato al convegno IEEE 15th AsianTest Symposium (ATS) tenutosi a Fukuoka, JP nel 20-23 Nov. 2006) [10.1109/ATS.2006.260989].
Memory Fault Simulator for Static-Linked Faults
BENSO, Alfredo;BOSIO, ALBERTO;DI CARLO, STEFANO;DI NATALE, Giorgio;PRINETTO, Paolo Ernesto
2006
Abstract
Static linked faults are considered an interesting class of memory faults. Their capability of influencing the behavior of other faults causes the hiding of the fault effect and makes test algorithm design and validation a very complex task. This paper presents a memory fault simulator architecture targeting the full set of linked faults.
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https://hdl.handle.net/11583/1499992
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