Exploiting Incrementality in SAT-based Search for Multiple Equivalence-Preserving Transformations in Combinational Circuits / Cabodi, Gianpiero; Dipietro, L; Murciano, Marco; Nocco, Sergio. - (2009). (Intervento presentato al convegno High Level Design Validation and Test Workshop (HLDVT) tenutosi a Grand Hyatt, San Francisco, CA, USA nel November 4–6, 2009).
Exploiting Incrementality in SAT-based Search for Multiple Equivalence-Preserving Transformations in Combinational Circuits
CABODI, Gianpiero;MURCIANO, MARCO;NOCCO, SERGIO
2009
File in questo prodotto:
Non ci sono file associati a questo prodotto.
Pubblicazioni consigliate
I documenti in IRIS sono protetti da copyright e tutti i diritti sono riservati, salvo diversa indicazione.
Utilizza questo identificativo per citare o creare un link a questo documento:
https://hdl.handle.net/11583/2279205
Attenzione
Attenzione! I dati visualizzati non sono stati sottoposti a validazione da parte dell'ateneo